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工作項目： 1. SOC integrator! A challenging job for integrating the designs from over 100 digital designers and tens of analog designers. A challenging job of using deep submicron process. 2. Building & Improving the standard environment for digital designers to run front-end flow, such as synthesis, STA analysis, linting, and so on. 3. Cooperating with APR designers for backend timing closure. 4. Block / Whole-Chip CTS (Clock-tree Synthesis) analysis and improvement. 應徵條件： 1. 碩士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、動力機械、自動控制、通訊工程等相關科系畢業為主。 2. 熟悉 verilog, verdi, STA, synthesis. 3. 具 CTS(Clock tree synthesis) Design/Debug經驗者尤佳。 4. 會寫 script如 perl者更佳。 5. 具六年以上相關工作經驗。

應變能力： 針對主機異常能快速診斷 標準化執行： 依照現行設備調整設定，確保 TCP/FTP 傳輸順暢。 現場與遠端： 處理各縣市設備的架接與調校。 職缺條件描述： 具備基礎Linux 系統操作與網路架構 具備基礎 Python 或 C++ 閱讀與修改能力 了解 TCP/IP、FTP 等通訊協議實作。 具備獨立排查硬體與系統問題的邏輯思考能力。

1. 協助開發UCIe基頻/協定層晶片，並能獨立閱讀相關協定文件及規劃電路架構。 2. 感測電路融合演算法設計與驗證。 3. 其他臨時交辦事項。

1. IC設計流程自動化開發與維護 2. EDA軟體/iPDK安裝與管理 3. 評估EDA軟體及矽智財 (Silicon IP) 需求 4. 協助提供學界EDA軟體及矽智財使用服務並提供技術支援 5. 其他主管交辦事項

1. IC設計流程自動化開發與維護 2. SoC設計平台開發與維護 3. EDA軟體/IP技術評估、安裝與管理 4. 提供學界EDA軟體、矽智財及SoC設計平台使用服務與技術支援 5. 其他主管交辦事項

1. 數位設計電路開發與維護。 2. SoC系統設計電路開發與維護。 3. 數位設計與晶片系統設計技術諮詢。 4. 其它主管交辦事項。

1. 數位晶片(Cell-based IC)設計驗證環境建置維護。 2. SoC設計平台開發維護與驗證環境建置維護。 3. 數位晶片與SoC設計驗證學界技術諮詢與協作服務。 4. 數位晶片與SoC設計驗證相關中英文訓練課程教材編寫與授課。 5. 其它主管交辦事項。

1. SoC設計平台與驗證環境相關工作規劃。 2. SoC設計平台開發維護與SoC驗證環境建置維護。 3. SoC設計驗證學界技術諮詢與協作服務。 4. SoC設計驗證相關中英文訓練課程教材編寫與授課。 5. SoC設計驗證相關國際合作。 6. 其它主管交辦事項。

1. 進行成熟(CMOS平面)製程/III-V族製程full custom設計環境技術服務。 2. 進行成熟(CMOS平面)製程/III-V族製程晶片實作/下線服務相關作業。 3. 協助FinFET製程full custom設計技術開發。 4. 協助寒暑假課程、IC設計競賽、IC技能檢定相關作業。 6. 執行主管交辦任務。