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DRAM IC circuit design: 1. Digital logic, Mixed Signal design , Verilog,Hspice 2. 需理解數位邏輯及CMOS元件動作, 可建立電路及模擬驗證 3. 對 Array structure & memory periphery control 有經驗佳 4. 對 High speed S2P/P2S, DLL clock de-skew, DCC 有經驗佳 5. 對 Design For Testing (DFT) 及BIST有經驗佳 6. 具備良好團隊合作精神及溝通能力, 主動且積極學習態度 Digital IC function part: 1. build up verilog testbench 2. fullchip verilog simulation/verification 3. verilog behavior models creation 4. pattern pool coverage raising up

瑞昱半導體【科技專才創造力學程實習計劃】將提供本計劃實習生： 1. 科技專才培育：規劃實習同仁專屬五大面向課程，培養專業、開發思考與創造力。 2. 賦予研究專題與實質任務。 3. 科別專責輔導員：每位實習生設有專屬輔導者，協助專業學習及問題引導。 實習期間：於2026年7月至8月進行專案實習與活動安排。 實習時間：週一至週五8:30-17:30，週休二日。 實習地點：瑞昱新竹一廠、二/三廠及生醫廠。 招募對象： 大三(含)以上、碩士班或博士班之電子、電機、電信、電控、資工、資科等相關科系在學生，具下列任一條件者佳： a. 熟C、C++、Assembly、Linux、SPICE、Matlab、Cadence EDA環境。 b. 熟類比電路設計、信號處理相關領域或有興趣者。 c. 熟ADC、PLL相關領域或有興趣者。 d. 對高速傳輸介面 (SerDes, PCIe, USB, PAM4) 電路設計有興趣者。 e. 對通訊網路、聯網多媒體、多媒體、電腦週邊產品或電路設計有濃厚興趣者。

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IC pick and place handler 設計開發與專案管理 1.自動化設備開發設計規劃(結構分析、流程規劃、設備設計、發包與規劃組裝) 2.設備規格認證 3.與客戶溝通開發需求 4.需出差 有意願外派至矽谷與Tier one 客戶共同執行專案尤佳

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(1)按照專案時程，規劃研發單位間設計資料傳遞計畫及跟催。 (2)協助聯繫公司各部門需求，協助按公司規範確保產品符合客戶需求。 『具工作經驗者，薪資另議』