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【公司介紹】 喬訊科技股份有限公司專注於高頻高速、高電流連接器產品之研發、製造與全球市場開發，產品應用涵蓋 AI Server、資料中心、工業自動化、電動車、機器人、通訊設備與高階電子設備等領域。公司初期將建立核心研發團隊，從產品設計、機構開發、材料選用、模具導入、樣品驗證到量產轉移，打造具國際競爭力的連接器產品線。 喬訊科技的目標，不只是成為一家連接器公司。我們希望建立具全球競爭力的高速傳輸與高功率互連技術平台，服務 AI、資料中心、工業自動化、機器人及新能源產業。 未來五年，我們將以台灣研發中心為核心，逐步建立中國製造基地、美國市場據點及新加坡區域營運中心。如果您期待的不只是工作，而是參與一家企業從 0 到 1、從台灣走向世界的成長歷程，我們誠摯邀請您加入。 本職位為喬訊科技創業初期核心職位，將直接參與公司產品策略、市場布局及全球營運體系建立。優秀人才未來將有機會晉升核心幹部並參與公司長期激勵與持股計畫。 我們不是在找員工，而是在尋找未來一起打造國際級連接器品牌的創業夥伴。 【工作內容】 1. 負責高頻高速、高電流連接器產品之機構設計與開發。 2. 依據客戶需求、應用場景與產品規格，進行連接器結構設計、材料選用與製程評估。 3. 使用 3D CAD 軟體進行產品建模、2D 工程圖、公差分析與設計文件建立。 4. 參與新產品開發流程，包括概念設計、樣品製作、測試驗證、設計修正與量產導入。 5. 與模具、沖壓、射出、電鍍、組裝、品保及供應鏈團隊協作，確保產品可製造性與品質穩定性。 6. 協助執行 DFMEA、設計審查、可靠度測試、失效分析與工程變更。 7. 支援業務與 FAE 團隊進行客戶技術溝通、規格確認及客製化設計。 8. 協助建立公司連接器產品標準、設計規範、測試規範與技術資料庫。 9. 針對高頻高速產品，協助 SI 工程師進行阻抗、串擾、插入損耗、回波損耗等設計優化。 10. 參與專利佈局與新技術平台開發。 11. 需配合供應商、製造基地或客戶端出差。 【薪資待遇】 依能力與資歷面議。具連接器產業資深經驗者另議。 除固定薪資外，公司提供： ■ 年度績效獎金 ■ 專案獎金 ■ 新產品開發獎勵 ■ Design Win 獎勵 ■ 業績達成獎勵 ■ 年度盈餘分紅制度 ■ 關鍵人才長期激勵計畫 ■ 未來員工持股計畫（ESOP） 依個人及團隊績效表現核發。 【教育訓練與人才培育】 公司重視人才培養與長期發展，提供： ■ 新人培訓計畫 ■ 專業技術訓練 ■ 專案管理訓練 ■ 領導管理課程 ■ 海外市場實戰培養計畫 優秀人才將有機會參與美洲、歐洲、新加坡、東南亞及大中華區市場開發專案。

工作內容： 1.負責網路IC的架構設計與安全分析 2.參與embedded secure boot的開發與驗證 3.協助客戶解決網路安全問題 4.進行車用網路安全相關的測試與驗證 5.瞭解網路攻擊技術與防禦方法 6.熟悉物理攻擊與防禦技術 7.進行滲透測試 應徵條件： 1.具有網路IC架構設計經驗 2.具有embedded secure boot開發與設計經驗 3.具有車用網路安全相關經驗，例如 ISO 21434、AUTOSAR 4.具有網路攻擊相關技術，例如 DoS、防火牆等 5.具有物理攻擊(physical attack)相關技術 6.具有滲透測試(penetration testing)相關技術

Key qualifications: 1. MS degree or above with EE or CS background 2. Familiar with SystemVerilog and Verilog 3. Exposure to OVM/UVM/VMM methodology 4. Exposure to constrained-random based verification environment 5. Exposure to create coverage model and drive coverage closure in including code/functional coverage. 6. Be able to develop a test bench from scratch 7. Hands on working experience on unit/block/full-chip level verification 8. Good communication skill 9. Leadership/management experience is a plus. Job descriptions: 1. Plan the verification strategy for SOC projects 2. Hands-on verification task of some of the units 3. Work closely with the design teams. 4. Drive the verification team, problem-solving on day-to-day works 5. Provide the measurable metrics for project leads and upper management. 6. Bug/coverage trend identification. Foresee the possible issues and plan for them. (MD17C0031)

工作項目： IC physical designer (APR) 應徵條件： 碩士以上; 電機工程、電子工程、資訊工程相關科系畢業為主

工作項目： 負責下列工作項目之一 1. High performance core physical implementation 2. Project Implementation and flow development. 應徵條件： 1. 碩士以上；電機、資訊科學、資訊工程相關科系畢業為主。

工作項目： 1. RF CP/FT測試程式開發及維護。 2. 產品良率的改善。 3. RF Probe card,Load board電路設計。 4. 測試電路Debug. 5. 須配合國內外出差。 應徵條件： 1. 學士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、通訊工程相關科系畢業為主。 2. 熟悉 C語言或VB. 3. 熟悉 V50/J750/Uflex操作。 4. 具RF測試背景者為佳。

徵才條件： 1. 碩士，大學&研究所均為電子電機相關科系畢業 2. 具3年以上相關工作經驗 3. 具備元件物理相關課程學分 4. 熟悉電子學或電子電路設計 5. 具積體電路 ESD 相關問題處理經驗或 I/O 電路設計經驗者尤佳 工作項目： 1. IC ESD、Latch up Review與改善 2. I/O Pads Design

工作項目： 1. 建立IC設計後段驗證流程，並撰寫自動化程式。 2. 建立並維護DRC/LVS/SVS/LVL/ERC/PERC相關檔案及流程。 3. 分析並解決PV相關問題。 應徵條件： 1. 碩士以上；電機、電機與控制、電信、電子、資工、資訊相關科系畢業為佳。 2. 無經驗可；具相關工作經驗者佳。 3. 熟悉 Linux工作環境以及 TCL/shell script. 4. 熟悉 Calibre(含TVF及SVRF)或 ICV. 5. 熟悉 FinFET或 BCD製程為佳。

1. Customer layout/SCH review 2. IC H/W IP Verification, signal measurement 3. SSD technical support for customer design-in 4. SSD customer issue analysis and debug 5. cross-team communication and cooperation for customer requirements and issue 6. Product promotion with PM/Sales

職務說明： 1. Create formal verification test plan. 2. Develop formal verification environment. 3. Run formal verification and regression, debug failures and analyze coverage. 4. Support other members in deploying formal verification. 5. Survey new formal applications and develop related workflow. 6. Enhance and maintain formal verification workflow. 徵才條件： A. Key qualifications : 1. Master‘s or above in Electrical Engineering, Computer Science. 2. Familiar with standard verification concepts and workflow. 3. Familiar with SystemVerilog and Verilog. 4. Familiar with scripting languages (Perl, Python, etc.). 5. Good communication skills. B. Preferred qualifications : 1. Familiar with SystemVerilog Assertion (SVA). 2. Familiar with formal verification methodology. 3. Familiar with formal tools (JasperGold, VCFormal). 4. Practical experience in formal verification, able to apply strategies to resolve issues during the verification process. 5. Familiar with bus protocol concept (AMBA). 6. Familiar with UVM methodology.