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工作項目： Verification for High Speed PHY projects, which includes: 1. Responsibility for test plans, testbench documentation and implementation. 2. Use SystemVerilog language, SVA and UVM methodology for block level verification. 3. Debug tests with design engineers to deliver functionally correct design blocks. 4. Close coverage measures to identify verification holes and show progress towards tape-out. 5. Write scripts to automate routine parts of verification workflow. 應徵條件： 1. 碩士以上; 電子、電機、資工、電信、電控、資科等相關科系畢業為主。 2. 具0~3年下列經驗之一者尤佳： (1) Experience verifying digital logic at RTL using SystemVerilog for FPGAs and/or ASICs. (2) Experience verifying digital systems using standard IP components/interconnects. (3) Experience creating and using verification components and environments in standard verification methodology. 3. Preferred qualifications: (1) Experience with high speed MAC/PHY RTL design or verification. (2) Experience with UVM methodology and coding. (3) Good English verbal communication skills.

工作項目： WiFi 6/7/8 MAC System Design and Verification 應徵條件： 1. 學士以上;電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、通訊工程相關科系畢業為主 2. 熟悉 Embedded System, ARM/MIPS CPU, Linux, C, Script, Makefile, and etc. 3. 熟悉 LA, Scope, CatC, and etc. 4. 具3年以上主要工作內容: a.) WiFi IP Verification b.) WiFi Design Spec & Architecture for Performance / System scenario / ... c.) Uboot / Linux development for WiFi d.) FW developement for WiFi internal CPU and SoC Netowork Sub-System e.) Research spec and test plan from IEEE-802.11 and WiFi-Alliance f.) Debug g.) ... 另有以下條件由為佳: a.) IC 開發經驗 b.) Computer Architecture c.) C Programming d.) Network protocol & concept e.) Embedded System f.) Uboot / Linux development experience g.) 個性好相處，能融入團隊 h.) 相關經驗者為佳

工作項目： Wlan NIC驗證/量產/客戶問題解決。 應徵條件： 1. 碩士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、通訊工程等相關科系畢業為主。 2. 熟悉 Embedded System, ARM/MIPS CPU, Linux, C, Script, Makefile, and etc. 3. 熟悉 LA, Scope, CatC, and etc. 4. 具5年以上經驗, 從事下列主要工作內容者為佳: (1) PCIe/USB/SDIO MAC Protocol Analysis and PHY/PCB debug. (2) WiFi debug and Cowork with other department. (3) Customer Issue Analysis and Debug. (4) IC Mass Production Test Plan including CP/FT. (5) RMA IC Analysis and FA(Failure Analysis). (6) 另具以下條件者(多項尤佳) : a.) IC開發經驗。 b.) Familiar with PCIe/USB/SDIO interface spec and debug. c.) Familiar with WiFi Knowledge and Debug. d.) PCB Schematic and Layout. e.) C Programming. f.) Network protocol & concept. g.) 個性好相處，能融入團隊。

監督現場管線施工工作及自主檢查，包括製造、安裝、運輸和吊裝，並負責管線工作的品質和安全活動。 工作內容： 1. 分項施工計畫、程序書編寫、WPS&PQR送審 2. 材料請購(請購規範填寫、材料填寫)、廠商資格送審 3. 施工廠商請購規範填寫及請購 4. 銲條請購 5. 素材管材、噴砂除鏽廠商請購需求單 6. 保溫施工請購需求單 7. 非破壞廠商請購需求單 8. 設計圖面Review 9. 港工許可送審 10.管線材料自助檢查 11.管線預製檢測 12.管線施作 13.管線安裝 14.非破壞檢測 15.試壓前檢查 16.保溫

1.協助處理生產線製程及設備問題 2.降低產品製程不良品率,維持生產線或產品製成有效運轉 3.新產品導入事情評估整體運作效能,並設法提高效率、降低生產成本 4.定期維護檢測及產線機械設備、操作控制及問題排除 5.開發新產品與評選材料，使新產品順利生產 6.規劃及指導生產及安裝組立方法,並繪製標準作業程序

1.依據需求規劃與建置 RF 系統，參與從概念設計到產品量產的完整開發流程。 2.測試驗證射頻電路效能，使用網路分析儀、頻譜分析儀等儀器進行RF電路測試與優化。 3.RF線路設計、阻抗匹配、PCB佈局與除錯，確保最佳射頻性能。 4.整合、測試、優化 RFIC 模組，負責無線通信、毫米波、射頻前端電路設計。 5.作為客戶技術窗口，協助技術問題溝通，參與專案會議並提供技術報告。

1. 測試待測試物品功能可正常運作，並撰寫操作sop 2. 協助現場工程師排除待測試物品操作問題 3. 協助現場客戶待測試物品功能設定，並記錄操作sop 4. 與外國客戶溝通 5. 處理主管交辦事項

工作項目： 1. PQ調校。 2. driver/測試程式撰寫。 3. 光學量測及校正。 應徵條件： 1. 碩士以上; 電子、電機、資工、電信、電控、資科、動力機械、自動控制、機械系控制組等相關科系畢業為主。 2. 熟悉 C, C++, Python. 3. 具1-2年以上 TV, panel, 色彩, AI-CNN相關影像處理經驗者尤佳。

工作項目：主要職責： • 參與建置設計與模擬的自動化流程。 • 參與建置與改善部門的專案管理流程。 • 參與API開發 ( 包含測試、性能優化與說明文檔撰寫）。 應徵條件： • 資工或電機等理工相關領域的學士或碩士學位。 • 具備 3 年以上的 Python 開發經驗。 • 重視程式的可讀性與可維護性。 • 具備良好的問題解決能力、溝通能力與團隊合作精神。 • 參與過開源專案或擁有 GitHub 個人作品者佳。 • 具備多人協作開發經驗者佳。 • 具備網頁設計的經驗者佳（JavaScript / Python-Flask, Django等）。 • 具備桌面GUI的開發經驗者佳（PyQt）。 • 熟悉常用Database者佳（如 MySQL、PostgreSQL、MongoDB）。 • 熟悉系統/電路的設計與模擬流程（如: Ansys和Cadence平台），並有相關的自動化經驗者佳。 • 熟悉 TensorFlow、Keras、PyTorch 等機器學習框架者佳。

工作項目： Verification for High Speed PHY projects, which includes: 1. Responsibility for test plans, testbench documentation and implementation. 2. Use SystemVerilog language, SVA and UVM methodology for block level verification. 3. Debug tests with design engineers to deliver functionally correct design blocks. 4. Close coverage measures to identify verification holes and show progress towards tape-out. 5. Write scripts to automate routine parts of verification workflow.