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1. New SBT vendor bring up , New SBT vendor YIP , troubleshooting and Ops ​ 2. 3D, 3.5D & e-IVR Technology Enabling, CPC/CPO technology building block development​ 3. Common strip format unification management ​ 4. Advanced PCB Ultra-Large size. I.e., CoWoP, DCAI PCB w/ high layer counts (PCB vendor ISU, GCE, UMTC, VGT ) ​ 5. PCB technology development and DRM owner

我們正在尋找在半導體設計實現 (semiconductor design enablement) 領域具備深厚背景的專家，主要負責先進製程與封裝 (如 3DIC, CoWoS) 的 PDK 開發及 RC 萃取開發。

軟體：HSI（USB、PCIE、MIPI、UFS、DP、HDMI等）系統軟體（Driver／FW）－設計與驗證 硬體：HSI（USB、PCIE、MIPI、UFS、DP、HDMI等）系統硬體（PCB／PHY）－設計、驗證及PPA分析

工作內容： 1. 精密類比電路設計，包含運算放大器應用與感測器應用。 2. 數位電路設計，涵蓋邏輯IC設計、介面設計及高速匯流排設計。 3. AC/DC、DC/DC電源電路設計，專注於高效能電源管理與穩定性測試。 4. PCB設計與佈局審查，確保電路板設計之準確性與最佳化。 5. 驗證與校準流程設計，提升產品功能與性能穩定性。 6. 測試系統的開發及維護，提升品質管控效率。 7. 熟悉FPGA或MCU開發技能者尤佳，協助硬體邏輯與微控制器設計。 8. 參與產品從開發至量產的流程規劃，確保項目順利執行。 歡迎有志於硬體設計與研發的夥伴加入我們，成為推動科技創新的一份子！立即投遞履歷，期待與您攜手創造更卓越的硬體產品與技術應用！

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Job Responsibilities • Work closely with circuit designers to complete the physical layout and its verification across different country •Receive a schematic from an Analog IC Designer and use a CAD tool to graphically design the layers of that schematic. •Use problem solving & strong communication skills, , experience, and creativity to layout circuits that meet size, schedule, and performance specifications • Run physical design verification tools to debug, improve, and verify layout blocks. • Ability to work independently & Collaborate with team members on continuous improvement opportunities in the flow, layout techniques, and design methodologies. •Each project can last from a couple months to a year and a half. •You will likely work on just one project in that time, but may be asked to switch to something else if priorities change. • Fluent in English is a plus Job Requirement •Bachelor‘s degree in Computer Science, Electrical Engineering or related fields with 3~5 years layout experience •Including at 1~2 years in FINFET process node. 5nm/3nm is preferable •Or 5+ years experience in IC layout design, especially ≥2 years in FINFET process node. 5nm/3nm is preferable • Full-custom circuit layout/verification. Experience in one or more of the following area is preferable • Mixed signal/analog/high speed layout, e.g. SerDes, ADC/DAC, PLL, etc •Familiar with Cadence Virtuoso environment and various industry physical verification tools (DRC,LVS, etc) •Proficient at debugging/fixing LVS/DRC errors •Experience with EMIR analysis, ESD, antenna and related layout solutions •Must have strong communication skills and be a team player

✨✨百大企業擴廠成徵技術員✨✨ ✨高薪職缺時薪日班$260 夜班$300 ✨名額有限要搶要快喔~ ✨主要做IPHONE手機製成 ✨正職年終平均7-10個月(20-30萬) ✨月休10-12天 ✨長期穩定 ✨免輪班/班別固定 ✨免費供2餐🍚 🕒 工作時間（可選）月休10天 日班: 08:00-20:00 (2小時吃飯休息 工時１０小時) 夜班: 20:00-08:00 (2小時吃飯休息 工時１０小時) 💰薪資待遇 日班:一天約2774 夜班:一天約3200 📍工作地點：桃園 ✨搶先報名請截圖職缺+Line喔✨ ʟɪɴᴇ 諮詢 : @981ckcbr

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