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• Define GPU compiler software architecture and interfaces. • Development/implement GPU compiler pipeline, linking and various optimizations/transformations. • Collaborate with Driver team, HW team to implement new API & HW features. • Collaborate with Driver team, HW team to improve/tune performance & power consumption. • Execute & deliver to meet milestones/schedules. • Analyze and debug code generation issues. • Construct reliable & trustable relationships across teams internally & externally.

1. 負責高速 Serdes相關開發, 包含驗證, 客戶支援 (熟悉架構, 韌體、除錯、優化及測試等工作項目) 2. 開發測試自動化 3. 協同團隊共同完成系統雛型建立及性能優化與調適 4. 達成客戶端產品導入，並支援產品量產

對於DFT晶片測試有興趣者，特別是 Automotive low DPPM DFT 以及 RISC-V DFT 領域， 負責開發與實行DFT流程，以降低測試成本、提高產品品質為目的 As a member of DFT engineering team, the candidate will develop methodologies and implement DFT for pre/post-silicon DFT flow and contribute to Automotive/RISC-V product test quality. Work with senior engineers across disciplines (DE, IMP, PE, TE) to meet low cost and high quality testing

1. 802.11 無線網路驅動程式與韌體開發. 2. 802.11 無線網路客制化協議開發. 3. 802.11 無線網路驅動程式與相關軟件在嵌入式系統的整合 4. 802.11 無線網路模塊驗證. 5. 北美客戶支持

• 執行5G/B5G基帶算法設計，包括(但不限於)波束成形機制、校準方法、射頻暴露控制等。 • 進行機器學習/人工智慧算法研究，尋找系統性能優化的潛在應用。 • 能夠在申請技術經理職位時指導初級工程師。 • 能夠協調多地點運營並參加跨時區會議(優先考慮)。

1. 負責晶片間（D2D & UCIe ) PHY IP硬體驗證與軟體開發。 2. 主導相關IP開發，熟悉ASIC專案中的軟體/SDK，能夠進行問題調試、最佳化和測試。 3. 與團隊合作，完成功能/系統啟動、驗證、效能最佳化和調整。 4. 實現產品設計導入，並支援產品量產。

1. 先進封裝BGA基板佈線與佈線實體驗證 2. 2.5D IC (CoWoS_S; CoWoS_L; CoWoS_R; EMIB) RDL 與基板佈線與佈線實體驗證 3. 與封裝設計工程師合作完成封裝設計需求與目標 4. 新封裝佈線方式評估與開發 5. 新封裝佈線輔助設計軟體評估

AI Model development, system level modeling and HW/SW system level bottleneck analysis

使用者體驗指標定義和品質保證，使用者體驗驗證工程師。 負責定義旗艦/高端/中端/低端的使用者體驗指標，預估未來用戶體驗發展，確保產品具競爭力。分析競品與客戶對接討論，開發測試手法與測試用例。 有Android phone 使用者體驗/功耗性能 設計或測試經驗，尤其有手機大廠相關測試規劃經驗者，將優先考慮。