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1. DT/ WKS硬體電路設計，使用CAD軟體開發電路圖。 2. 進行硬體原型測試，執行功率和性能基準測試，優化設計。 3. 從設計分析確認Design Quality,處理設計相關的問題，確保產品品質。 4. 診斷硬體故障，提供技術支援。 5. 新技術研究開發與導入

#協助業務設計師進行丈量、繪圖與資料彙整。 #協助業務整理報價與協助報價發包。 #門市早晚開閉。 #備有獎金制度，無業績壓力。 【加分條件】： – 熟悉 SketchUp / AutoCAD / 酷家樂 任一工具者佳，無經驗亦可由主管帶領學習。 – 曾具備設計、裝修或相關助理工作經驗者尤佳，但不設門檻。

1.依照資深工程師的設計，完成產品的硬體開發（如：原理圖、PCB佈線圖、BOM表）。 2.客戶規範的性能驗證(產品測試)。 3.基板生產製造標準和規範撰寫。 4.對於產品設計有高度興趣。

【職務說明】 1. 葬儀會場鮮花佈置、製作。 2. 整理鮮花材料。 3. 主管交代事宜。 **想學習花藝者公司可培訓插花技能，歡迎想學習一技之長者加入本公司。 【公司福利】 1. 享勞健保、勞退、各式獎金、餐費、誤餐費、聚餐。 2. 週週休、紅字休(排休制度)。 3. 提供公司制服。

1. 設計伺服器硬體組件（如主板、CPU、IO卡），使用CAD軟體開發電路圖。 2. 進行硬體原型測試，執行功率和性能基準測試，優化設計。 3. 支持製造和客服，診斷硬體故障，提供技術支援。 4. 需要時與供應商溝通，處理設計相關的問題，確保產品品質。 5. 替代料選用與BOM製作。

我們正在尋找一位對「美感」有高度執著，同時能用「邏輯」解決問題的設計師。你將負責打造網站平台的視覺介面，並確保每一處細節都符合使用者的直覺操作。 【工作內容】 ◆ 視覺與介面設計 - 品牌視覺標準化：規劃網站與行動裝置的主視覺，建立並維護 Design System ，確保元件的高重用性與一致性。 - 高質感 UI 產出：深入運用顏色理論、排版與動態微互動，設計具備競爭力的 Web/App 介面。 - 多媒體視覺延伸：負責行銷活動頁 (Campaign Page)、Banner 及品牌數位視覺素材的創意發想與執行。 - 設計交付與管理：標準化設計資源命名與歸檔，確保與工程團隊的協作流程流暢、無痛對接。 ◆ 體驗流程與研究 - 流程規劃：根據需求產出 User Flow 與 Wireframe，確保產品操作路徑簡潔且無障礙。 - 需求轉化：參與產品需求討論，能從 UX 角度對規格提出建議，平衡美感、技術可行性與商業目標。 - 持續優化：追蹤上線後的數據反饋或客服痛點，提出介面優化方案以提升轉換率。 【職務條件】 - 視覺能力：具備優秀的網頁與行動裝置視覺設計功底，對字體、間距與色彩有極高敏銳度。 - 工具專家：精通 Figma ；熟練 Photoshop 與 Illustrator。 - 邏輯分析力：具備閱讀 Function Flow 的能力，能將複雜的功能結構簡化為易懂的介面配置。 - 溝通與提案：能有效說明設計背後的邏輯（為何這樣排？為何用這顏色？），並具備跨部門協作的彈性。 - 響應式思維：熟悉 RWD 與斷點設計邏輯，理解不同螢幕尺寸下的內容優先順序。 【加分條件】 - 進階元件管理：有管理複雜 Design System 或開發 Token 命名經驗者優先。 - AI 工具導入：熟悉 Midjourney 或 Adobe Firefly 等工具，能運用 AI 提升視覺素材產製效率。 - 前端技術理解：理解 HTML/CSS Flexbox 邏輯，能與工程師討論 CSS 效果。 - 動態設計：具備 Lottie 或 After Effects 基礎，能製作介面轉場與動態 Icon。

1.與PdM、系統用戶合作，理解 AI DCIM 在設備監控、能效分析、資產管理等場景中的使用需求，轉化為具體介面設計需求並進行高保真 UI 界面設計。 2.制定並落實 UI 視覺規範與設計系統（顏色、字體、圖標、佈局），保證跨平台（Web、Mobile、大屏等）的一致性與專業感。 3.與全棧開發工程師合作，輸出設計規範、UI 元件庫，參與前端實現驗證，確保設計效果與最終產品一致。 4.規劃用戶使用行為搜集與分析策略，分析用戶使用狀況，對系 UI/UX 進行持續優化與改進。

學歷：數位學習、教學科技相關科系。 知識技能： (1)具備腳本撰寫、教學設計能力。 (2)已有操作課程製作軟體如Articulate、Storyline等軟體經驗者為佳。 【其他薪資加給：新進正用後依工作表現與成果，依單位之績效獎金制度，另加核每季績效獎金(0~2,500元)。】

1. AFE（Analog Front End）設計 • 超低電流量測（nA ~ pA） • 高阻抗電化學感測前端 • Chopper Amplifier / Low-noise TIA • 1/f noise 抑制設計 2. 超低功耗系統設計 • Battery life ≥ 14 天 • Duty cycling / sleep control • 超低功耗 MCU / SoC 選型 3. 訊號鏈整合 • ADC 架構選擇（ΔΣ 常見） • 電源完整性（PSRR、LDO noise） • EMI / ESD 設計（穿戴式痛點）