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工作項目： 1. 開發video/sensor HDR合成演算法 2. 開發數位防手震(DIS)的演算法 3. 開發參考幀壓縮(RFC)的演算法 4. 開發動態對比強化(DCI)的演算法 應徵條件： 1. 碩士以上;電機工程、電信工程、資訊工程相關科系畢業為主 2. 熟悉 C/C++/Matlab 3. 具3年以上Camera ISP算法設計，以開發過HDR/EIS/RFC/DCI算法等相關經驗者為佳。 (MD17B0015)

工作項目： 負責數位電路自動繞線工作(P&R, Netlist2GDS)，包含 IR-Drop, DRC/LVS, SI, Timing Sign-off等。 應徵條件： 1. 碩士以上; 電機工程、電子工程，電信工程、電控工程、資訊工程、資訊科學、通訊工程等相關科系畢業為主。 2. 熟悉 Synopsys ICC2/PrimeTime, Cadence Innovus/Tempus, Redhawk, Calibre DRC/LVS, TCL/python/Perl。

工作項目： 負責 Physical design(APR & IC Fully Layout)。 應徵條件： 1. 碩士以上; 電機、電子、電機與控制、自動控制、計算機、微電子相關科系畢業為主。 2. 對 IC Layout有興趣者為佳，具3-5年以上相關工作經驗者尤佳。

1.熟3D繪圖siemens solid Edge軟體 2.會PLC程式及電腦C語言能力且具有機械、電機、電子、資訊、電工配線相關科系工程師二年以上經驗者

1.熟3D繪圖siemens solid Edge軟體 2.會PLC程式及電腦C語言能力且具有機械、電機、電子、資訊、電工配線相關科系工程師二年以上經驗者

工作項目： 韌體撰寫及解決客戶問題 應徵條件： 1. 碩士以上;電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、動力機械、自動控制、通訊工程相關科系畢業為主 2. 熟悉 C語言 3. 熟悉 Orcad

工作項目： IC Fully Layout. 應徵條件： 1. 大學以上; 電機、電機與控制、電子等相關科系畢業為主。 2. 需會操作 Virtuoso XL/Mentor Calibre verification/Totem。 3. 具備 Fin-FET先進製程及 ESD、latch up、IR/EM相關知識。 4. 具 Mixed mode佈局相關經驗者尤佳。

工作項目： 1.Responsible for physical design, including fully custom layout and Auto Placement and Routing. 2.Verification and specification achieved. 應徵條件： 1.大學以上；電機, 電機與控制, 資訊科學, 自動控制, 通訊工程, 電信, 資訊工程, 電子相關科系畢業為主。 2.具相關工作經驗者為佳。 (MD1710005、MD1810021)

工作項目： 1. RF CP/FT測試程式開發及維護。 2. 產品良率的改善。 3. RF Probe card,Load board電路設計。 4. 測試電路Debug. 5. 須配合國內外出差。 應徵條件： 1. 學士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、通訊工程相關科系畢業為主。 2. 熟悉 C語言或VB. 3. 熟悉 V50/J750/Uflex操作。 4. 具RF測試背景者為佳。