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Microprocessor design. Desired skills and experience includes: 1. Knowledge of DSP, microprocessor and computer architecture fundamentals. 2. Experience in RTL design and ability to make trade-offs between power, performance and area appropriately. 3. Experience in the microprocessor design cycle: initial concept, micro-architecture, implementation, verification, documentation and support.

1.洗髮、護髮、頭皮護理、染髮、上燙髮藥水 2.主要從事顧客髮型的修剪、設計、吹燙、與染護保養服務及造型設計。 ．執行美髮用品使用、設備做修髮、洗髮及吹整髮型等操作 3.想當經營者這裡就是你的舞台 想往講師發展由多元教育團隊等著你

1. Video conference產品設計。 2. 與團隊合作配置零件位置，考慮產品需求建立3D模型，2D工程圖面。 3. 手工模型製作與檢討，開模、試模檢討與修模，試產中機構相關事項處理。 4. 組裝、測試、外觀等機構相關問題分析、解決及改善等。

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1.規劃與設計相關工程如：生態工程、水保工程、土木工程、水利工程,治山防災等工程 2.溪流整治、道路工程,結構工程等規劃,設計 3.與業主溝通，了解需求，到施工地點進行視察，並參考現場的地形、地質、氣象、水文等情況4.依照業主需求完成整體設計圖 5.規劃工程時程、預算與成本的控管、人員與時間的掌控並且撰寫施工說明書及施工規範 6.監督工程進度、工地現場驗收與承商管理 7.施工地的探查以及當地水文水理的研究 8.水利設施的設計 9.指導工程人員進行河川整治工程或水利設施建造、運輸、維護及修繕

我們不是傳統成衣公司。 從蠶絲面料開發、織造、商品設計到成衣生產，公司擁有完整供應鏈與泰國自有工廠。 我們希望找到一位能真正掌握「生產流程、進度與品質」的人加入團隊，協助整合台灣設計端與海外工廠生產。 如果你熟悉成衣流程、擅長協調安排、能處理生產問題，這份工作會很有成就感。 ⸻ 【工作內容】 1. 成衣生產排程與進度追蹤 2. 台灣設計端與泰國工廠生產協調 3. 面料／副料／版型／樣品進度管理 4. 大貨交期與生產品質控管 5. 生產異常問題協調與處理 6. ERP、生產表單與資料整理追蹤 7. 協助建立與優化生產流程SOP 8. 跨部門溝通協調（設計／採購／工廠） ⸻ 【職務需求】 ✔ 具成衣生管、跟單或相關經驗 ✔ 熟悉成衣生產流程 ✔ 細心負責，具備時間管理能力 ✔ 具良好溝通與協調能力 ✔ 熟悉Excel操作與表單管理 ⸻ 【加分條件】 ✔ 有海外工廠對接經驗者佳(講中文可) ✔ 熟悉針織、女裝、內著類商品尤佳 ✔ 了解面料、版型、車縫流程 ✔ 對AI工具與流程管理有興趣者佳 ⸻ 【公司特色】 ✔ 台灣設計 × 泰國自有工廠 ✔ 自有蠶絲品牌與完整供應鏈 ✔ 商品具市場差異性與穩定客群 ✔ 穩定長期發展品牌 ✔ 重視制度建立與團隊合作 ⸻ 【薪資待遇】 月薪 NT$60000以上 （依能力與經驗調整）

(1) 碩士以上電機、資訊相關科系畢業。 (2) 熟悉 Verilog RTL、Synthesis、Simulation、Timing Analysis 等相關 IC Design Flow。 (3) 熟悉 Design for Testability 技術，包含 Scan / ATPG、Delay Test、Memory BIST、Boundary Scan、Diagnosis 等。 (4) 有 DFT Tools (如 DFT Compiler、TetraMAX、BSD Compiler、FastScan、TestKompress、MBISTArchitect) 使用經驗者佳。 (5) 積極負責、勇於迎接挑戰，對於 Nanometer / SoC DFT Implementation、開發及推廣設計流程有興趣者。

應徵條件： 1. 碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2. 熟悉 Verilog RTL Design、SoC Integration & Design Flow、Frontend EDA Tools、Synthesis & STA Methodology、Low Power Design & Verification。 3. 具備 IP Integration、Hierarchical Implementation、Verification 能力；熟悉 TCL/Perl/C++/Python。 4. 英文能力良好，聽說讀寫精通。 5. 有 CPU、GPU、Multi-Core Processor Development 經驗尤佳，例如 Design/Integration/Synthesis/DFT/Timing Closure/Sign-off/Production 等。 6. 積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。 工作項目： 1. High-Performance CPU & GPU Frontend Implementation 2. Advanced CPU Technology Development: High-performance, Ultra-low Power, and PPA Optimization 3. Processor Frontend Development Flow Enhancement & Automation 應徵條件： 1. 碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2. 熟悉 Verilog RTL Design、SoC Integration & Design Flow、Frontend EDA Tools、Synthesis & STA Methodology、Low Power Design & Verification。 3. 具備 IP Integration、Hierarchical Implementation、Verification 能力；熟悉 TCL/Perl/C++/Python。 4. 英文能力良好，聽說讀寫精通。 5. 有 CPU、GPU、Multi-Core Processor Development 經驗尤佳，例如 Design/Integration/Synthesis/DFT/Timing Closure/Sign-off/Production 等。 6. 積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。

工作項目： 負責伺服器系統管理週邊SoC/ASIC的軟硬體開發驗證/除錯/撰寫，詳細內容如下 1. 晶片系統架構設計: CPU/Platform/IO interface，架構規劃 2. 功能模塊驗證: Security Function, Remote Function, high-speed I/Os. 3. 韌體程式開發: OpenBMC FW, SoC BSP Driver 4. 系統驗證除錯 5. 量產測試設計 應徵條件： 1. 碩士以上，背景電機/資工/電控/自控/資科等科系者佳 2. 具下列條件其一者： a) 伺服器系統週邊晶片系統設計5年以上經驗 b) OpenBMC, DMTF規格軟韌體開發 5年以上經驗 3. 熟悉Server HW management軟硬體；熟BMC FW/DMTF 管理架構者優選 4. 與Server platform venders(e.g., I/A/N...)有長期技術合作經驗者優選

徵才條件： 1. 碩士以上電機資訊相關科系畢 2. 熟悉 Verilog RTL 及 Synthesis, Simulation 等相關 IC Design Flow 3. 熟悉 Computer Architecture 4. 有下列經驗者更佳： (1)Microprocessor或DSP相關硬體設計 (2)On-chip Bus, DDR/Flash Memory Controller, PCIE, USB等設計